El nuevo DSP PAM4 1.6T Rushmore, que ofrece hasta 200G por canal con mejoras en eficiencia y funciones de diagnóstico, ayuda a optimizar el rendimiento de redes ópticas de alta velocidad en proyectos IA/ML y centros de datos.
MaxLinear, fabricante de circuitos integrados (CI) de interconexión de alta velocidad para redes metropolitanas y centros de datos, anuncia la disponibilidad de su nueva solución DSP PAM4 1.6T Rushmore, con el objetivo de dar respuesta a la creciente demanda de conectividad en centros de datos y entornos de inteligencia artificial (IA) y aprendizaje automático (ML).
Este dispositivo, construido sobre tecnología CMOS avanzada, permite alcanzar velocidades de hasta 200G por canal y, gracias a un consumo optimizado, se puede integrar en módulos ópticos de menos de 25 W.
El DSP PAM4 1.6T Rushmore aprovecha las últimas evoluciones de tecnología SERDES y DSP de la compañía, fruto de tres generaciones de diseño que abarcan desde 100G hasta 800G.
Así pues, este modelo ha sido desarrollado para soportar interconexiones de alta capacidad mediante cobre activo u óptica y se alinea con los estándares de interoperabilidad definidos por OIF, IEEE e IBTA.
Arquitectura de baja latencia y funciones de autoajuste
Una de las características destacadas del DSP PAM4 1.6T Rushmore es su arquitectura optimizada para baja latencia, diseñada específicamente para redes IA/ML donde los retardos deben mantenerse al mínimo.
Mientras, dicha arquitectura se combina con una serie de modos de bajo consumo que permiten ajustar dinámicamente el presupuesto energético del enlace en función de la demanda.
Además, el dispositivo incorpora capacidades de autoajuste mediante DPD digital automatizado, que contribuyen a aumentar el rendimiento del transmisor con diversos tipos de láser, incluyendo tecnologías EML y fotónica de silicio. Como consecuencia, se facilita su implementación en distintos entornos ópticos.
Diagnóstico avanzado e integración con TIA
El DSP PAM4 1.6T Rushmore cuenta con herramientas avanzadas de diagnóstico, como detección y localización MPI, monitorización de tasa de errores previa a FEC (pre-FEC BER) y una matriz de conmutación 8×8, que garantizan una monitorización exhaustiva de la integridad del enlace.
Esta novedad dispone de la opción de driver integrado que proporciona una alta excursión de salida para reducir el consumo total del sistema.
El diseño se complementa con la posibilidad de integrarse con el TIA Washington del propio fabricante, resultando en una solución conjunta DSP + TIA optimizada para maximizar las prestaciones en aplicaciones de alta velocidad.
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